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1. 負(fù)責(zé)模擬及數(shù)?；旌闲酒枨笠?guī)格分析和定義、芯片的架構(gòu)設(shè)計；
2. 負(fù)責(zé)模擬及數(shù)?；旌舷到y(tǒng)設(shè)計、關(guān)鍵指標(biāo)分解；
3. 負(fù)責(zé)模擬及數(shù)模混合電路設(shè)計、仿真驗證；
4. 負(fù)責(zé)指導(dǎo)版圖工程師進(jìn)行版圖設(shè)計，并進(jìn)行后仿真驗證和版圖問題分析定位；
5. 負(fù)責(zé)或參與測試、問題定位、設(shè)計優(yōu)化工作。

任職要求：
1. 碩士及以上學(xué)歷，集成電路、微電子、計算機、通信等相關(guān)專業(yè)；
2. 5-7年及以上工作經(jīng)驗，有項目管理、團(tuán)隊管理經(jīng)驗優(yōu)先；
3. 熟練掌握晶體管級、模塊級電路設(shè)計及后端實現(xiàn)，在Serdes如MIPI，PCIE，USB等領(lǐng)域有豐富的量產(chǎn)及問題定位經(jīng)驗； 擅長Verilog/VerilogA及系統(tǒng)建模；
4. 勤學(xué)善問、自學(xué)能力強，能獨立思考和解決問題，對新技術(shù)有濃厚的興趣和追求；
5. 有良好的團(tuán)隊合作精神，有強烈的責(zé)任心和上進(jìn)心，勇于挑戰(zhàn)，銳意進(jìn)取。