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工作職責:
1. 負責編碼器模塊級架構設計；
2. 負責編碼器模塊級的RTL開發(fā)和維護；
3. 負責編碼器模塊級驗證、綜合和時序收斂。
任職資格:
1、計算機或電子類專業(yè)碩士及以上學歷，3年以上工作經(jīng)驗；
2、熟練掌握Verilog HDL和C/C 語言；
3、熟練掌握ASIC前端設計流程（Verification、Synthesis、STA、DFT等），熟練使用各種主流EDA工具；
4、掌握Perl/Tcl/TK等腳本語言；
5、有H.264/H.265/H.266標準編碼器開發(fā)經(jīng)驗優(yōu)先；
6、有成功流片項目經(jīng)驗者優(yōu)先。