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崗位職責(zé)：
1、仿真平臺(tái)的搭建和維護(hù)，協(xié)助軟件團(tuán)隊(duì)SDK開(kāi)發(fā)和系統(tǒng)調(diào)試；
2、根據(jù)需求定制驗(yàn)證計(jì)劃，編寫(xiě)驗(yàn)證代碼并調(diào)試，分析驗(yàn)證代碼的覆蓋率分析；
3、負(fù)責(zé)模塊及系統(tǒng)的前仿、后仿、功耗分析及時(shí)序分析，定位并報(bào)告Bug。


崗位要求：
1、電子信息及相關(guān)專業(yè)本科以上學(xué)歷；
2、熟悉UVM等驗(yàn)證方法學(xué)，7年IC驗(yàn)證工作經(jīng)驗(yàn)及以上；
3、熟悉Verilog硬件描述語(yǔ)言，有較強(qiáng)的驗(yàn)證經(jīng)驗(yàn)，有項(xiàng)目完整的驗(yàn)證經(jīng)驗(yàn)，能夠進(jìn)行代碼、功能覆蓋率分析；
4、具有較強(qiáng)的腳本能力，例如tcl、perl、makefile\python、shell等；
5、熟練使用主流的EDA工具；有FGPA驗(yàn)證工作經(jīng)驗(yàn)者優(yōu)先；
6、做過(guò)混合仿真，或者有混合仿真的經(jīng)驗(yàn)。